作者woko (孤.獨.一.痕)
看板Electronics
標題[問題] 運算放大器輸出端接MOS閘極的用意?
時間Fri Nov 8 10:21:00 2013
請教各位高手:
最近讀到OP的章節,也去網路下載了一些文章回來研讀,
發現有一種OP的接法會把OP的輸出端接到一顆MOS的gate,
然後再拉一條負回授的路徑回到輸入端.
我目前對於這種接法存在兩個疑惑:
(1)請問一下這種接法的好處是甚麼呢?是為了改善甚麼特性嗎?
(2)就我的認知,負迴授的OP輸出應該是一個很接近0V的電壓,
這種接法為什麼能work呢?
麻煩有相關經驗的人能指點一二,非常感謝!!!
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◆ From: 122.147.248.242
1F：推 lion21:蠻典型的回授控制 負回授的點通常在電壓電流偵測 11/08 10:48
2F：→ woko:可是如果OP的輸出是0V,那這樣MOS不會關閉嗎? 11/08 11:19
3F：→ woko:因為我看到的電路是NMOS的gate接在OP輸出端, 11/08 11:20
4F：→ woko:負迴授是從NMOS的drain拉回OP的輸入,所以才覺得怪怪的?? 11/08 11:21
5F：推 lion21:0V就會關閉. 回授那邊應該還有個負載或是電阻對電源 11/08 13:53
6F：推 lion21:很多負載定電流控制都是這樣做的 11/08 14:02
7F：推 wxes60711:輸出很接近0V? 你確定那是大信號嗎? 11/08 14:39
8F：推 Baneling:聽起來像LDO 11/08 20:32
9F：→ viniminghao:linear controller? 11/08 21:08
10F：推 jamtu:OP的輸出不會是絕對值的0V 11/09 00:29
11F：推 jfsu:regulator? 11/09 00:33
12F：→ bulcas:OP 的輸出不會是對地 0V。 11/09 12:16
13F：推 andy12367892:你這應該是LDO吧 穩壓器的接法 11/11 07:52
14F：→ woko:感謝各位的回覆,我用LDO找關鍵字找到了!! 11/12 09:07