作者charlink (charlin)
看板Electronics
標題[問題] 0-10V dimming設計NPN短路疑問
時間Tue Dec 24 21:48:47 2024
請教各位大神
在網路上有看到2份相同設計的0-10V dimming電路，
PWM訊號經過LPF後再接DC gain 3倍的線路，請問當Q1導通時，
DIMMER這端0-10V的電壓不會對地短路嗎?
請大神幫忙解答，謝謝!
https://imgur.com/qV7RFhY
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1F：推 HiJimmy: dimmer這隻腳是輸出腳，不是接電壓源，就不會有這個問題 12/24 23:41
2F：→ HiJimmy: ，NPN是加速關斷速度，放電用的吧 12/24 23:41
3F：推 kdjf: Q導通就是全開而已啊，dimmer是接負載 12/25 07:06
4F：推 yunnlai: 這是積分器電路，不是 Gain 3。 12/25 07:24
5F：→ yunnlai: R6,C3決定斜率。 12/25 07:24
6F：→ kdjf: 行為不是當積分器用，opa +input接的是附載端而不是定電壓 12/25 10:43
7F：→ kdjf: 所以會當作inverting follwer with delay用 12/25 10:44
8F：推 kdjf: OPA的"+"端回饋接在output inverter上，所以思考上這是完整 12/25 10:49
9F：→ kdjf: 回饋電路的"-"端，整體電路變成一個正相放大器。 12/25 10:49