作者erspicu (.)
看板Tech_Job
標題[請益] netlist模擬加速的可能
時間Mon Jun 1 23:44:54 2026
因為這太偏於晶片相關議題了
感覺不是soft_job範圍 簡單來說我想尋找一個方式
讓CPU跑NETLIST模擬運算能跑到實機速度
我知道網表跑模擬存在巨大運算量鴻溝
但我只是想讓我家電腦cpu跑模擬 把運算效率拉到42.95M hc/s
結果透過一堆方式只有拉到 大概100k多 hc/s...
這都已經是40年前爛得要死的cpu和PPU 完全沒想到這麼困難...
最後問AI建議 透過IR和CODEGEN去進階處理 結果還更慢
結果繞了半天 慢慢把study的東西整理起來 (我不是這領域的 是透過ai工具輔助)
還是得到我不甘心的說法 就是不可能....
我要的是cpu(不要fpga) 程式自動抽象化 不人工介入進行單元件抽象描述提升
學術界
https://erspicu.github.io/AprVisual/landscape.html
實作撞牆
https://erspicu.github.io/AprVisual/ceiling.html
AI的殘酷回覆
https://erspicu.github.io/AprVisual/study.html
但就很不甘心 會不會晶片模擬技術在最近10年
有沒有什麼突破的方法 我還不知道
還是以業界來說
即使用CPU跑NETLIST模擬40多年前 PPU+CPU兩顆晶片
以現在算力來說真的沒別方法可行?
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1F：→ jason90814: 模擬用cpu跑一定快不了 複雜度就擺在 49.216.252.82 06/02 08:02
2F：→ jason90814: 那邊 所以才有fpga 49.216.252.82 06/02 08:02
3F：→ foxmoulder: 工欲善其事 必先利其器 懂！ 42.73.189.2 06/02 09:10
4F：→ Naessean: 我不太理解這件事的價值在何處, 以業界 42.72.30.174 06/02 09:10
5F：→ Naessean: 來說正常應該是不會特意花時間去做這件 42.72.30.174 06/02 09:10
6F：→ Naessean: 事的, 你所謂的netlist只是gate-level n 42.72.30.174 06/02 09:10
7F：→ Naessean: etlist, 再往下還有transistor-level ne 42.72.30.174 06/02 09:10
8F：→ Naessean: tlist, 你想要sim到多底層又想拿到什麼i 42.72.30.174 06/02 09:10
9F：→ Naessean: nformation呢？或是你只有gate-level ne 42.72.30.174 06/02 09:10
10F：→ Naessean: tlist, 而沒有RTL code呢？ 42.72.30.174 06/02 09:10
11F：→ douge: 乖乖去學數學就是捷徑140.112.175.204 06/02 09:11
12F：推 gn01216674: EDA裡面高手非常多 歡迎你 114.137.48.156 06/02 10:05
13F：→ douge: 因為已經很多高手了 新人進去就是套模組140.112.175.204 06/02 10:16
14F：→ douge: 唯一的捷徑就是乖乖去念數學140.112.175.204 06/02 10:17
15F：→ douge: 才能活得下去140.112.175.204 06/02 10:17
16F：→ samm3320: 嗯…不是這個領域為什麼要煩惱這個 42.72.225.40 06/02 11:22
17F：→ samm3320: 要嘛進入這個領域去EDA公司搞，不然就 42.72.225.40 06/02 11:23
18F：→ samm3320: 花錢買機器最有效率吧 42.72.225.40 06/02 11:23
19F：→ bnn: 你要重刻一個底層 125.227.13.36 06/02 15:58