作者sovereignty ( )
看板Electronics
標題Re: [問題] gm/id vs id/w作圖hspice
時間Mon Dec 28 08:32:24 2015
※ 引述《foye0922 (TJ)》之銘言：
: 我從 Stanford 的講義裡看到了用gm/id 可以減少調電路的時間，但問題是
: Gm/id vs id/w 但是目前我無法得知該如何在hspice 上表示
: 已經嘗試設計common source 架構，但目前卡在不知道該如何表達想要的波型！和課本上不同
: 我看各方等都是用。 matlab搭配，但我覺得很不方便，想問大家是如何模擬的呢？
gm 可以用 HSPICE 內建的 output template 指令取得。
如果是 BSIM4 model (planar)，指令是 LX7() 如 LX7(m1)
如果是 BSIMCMG model (FinFET)，指令是 LX564() 如 LX564(m1)
其他指令可以在 hspice_mosmod.pdf 文件中查到。
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1F：推 mos888tw: 用這個設計方法的板友不妨想想obov的推文 可以玩玩 12/28 21:44
2F：→ mos888tw: 但這方法要看怎麼用 不要太執著 12/28 21:44
3F：推 wxes60711: 在murmann的上課講義有提到 這個方法用的好除了減少 12/29 00:34
4F：→ wxes60711: iteration的次數外 配合計算可以得到best-optimal而非 12/29 00:35
5F：→ wxes60711: sub-optimal的結果 用matlab掃參數真的比spectre快多了 12/29 00:36
6F：→ wxes60711: 做沒碰過的製程時 抽這些參數出來對各種電路設計也夠用 12/29 00:37
7F：→ wxes60711: 了 總之我覺得gm/id是個好方法 12/29 00:38
8F：推 obov: 樓上 我直接問你一個問題 你用gm/id法設計過甚麼東西? 12/29 14:44
9F：→ obov: 我說白惹 同樣的電路改個spec 你的gm/id法就要假賽 12/29 14:45
10F：推 obov: 還有 我認為喇 只有人腦難以理解的非線性電路需要掃參數 12/29 14:48
11F：推 obov: 設計amplifier之類的還要拿matlab出來掃 時間太多 12/29 14:50
12F：推 wxes60711: MATLAB只要script寫好 同一個process做過一次就好了 12/29 20:02
13F：推 wxes60711: 我的意思可能沒有很明確 現在要做一個OP的話 SPEC給定 12/29 20:06
14F：→ wxes60711: 之後要怎麼開始著手? L要給多大? W/L又要多大? 12/29 20:07
15F：→ wxes60711: loog bw又要多少? 以現在的process來說當然不可能用手 12/29 20:09
16F：→ wxes60711: 算完成 普遍都會拿你要用的mos device來單顆trial一下 12/29 20:10
17F：→ wxes60711: 吧? 如果是這樣做 那gm/id method就有它的價值在 12/29 20:11
18F：→ wxes60711: 1.gm/id-Vov 2.ft-Vov 3.ft-gm/id 4.gmro-gm/id 12/29 20:13
19F：→ wxes60711: 5.Id/W-gm/id 12/29 20:13
20F：→ wxes60711: 配合你的spec 可以從以上這些圖的任意一點切入 當然一 12/29 20:15
21F：→ wxes60711: 開始還是要先丟其中一個參數定值下去找 就可以找到你需 12/29 20:17
22F：→ wxes60711: 要的其他參數值 matlab index function做這件事並不難 12/29 20:18
23F：→ wxes60711: 而且只要寫好一次以後csv data直接丟進去就可以index 12/29 20:18
24F：→ wxes60711: 只要data樣本夠多 配合interpolation都可以找出相當接 12/29 20:20
25F：→ wxes60711: 近的解 實際spectre模擬結果也不會差很多 我認為這就是 12/29 20:20
26F：→ wxes60711: 一個好的computer-aided電路設計方式 12/29 20:21
27F：→ wxes60711: Local的matlab吐值的速度我相信還是比terminal的spectr 12/29 20:21
28F：→ wxes60711: e快很多 12/29 20:22
29F：推 obov: 通常喇 一個有經驗的analog designer 12/29 21:23
30F：→ obov: 看到spec大概會知道哪些地方可能會緊繃 12/29 21:23
31F：→ obov: 然後從可能會緊繃的地方開始下手 12/29 21:24
32F：→ obov: 你的gm/id等等東西的作圖法or matlab法 12/29 21:25
33F：→ obov: 最大的問題就是 看到PVT你依樣看到哭 有圖=無圖 12/29 21:25
34F：推 obov: 還有正常情況下變化也比你想像的多 光是bias就可以讓你的 12/29 21:28
35F：→ obov: 讓你的gm/id法再哭哭一次 12/29 21:28
36F：推 wxes60711: 這是當然 但是gm/id並不只可以拿來design 在剛接觸製程 12/29 21:40
37F：→ wxes60711: 的時候去做這些圖 了解不同region的現象我認為還是必須 12/29 21:41
38F：→ wxes60711: 的 而且說真的如果不是maintain或modification我覺得起 12/29 21:42
39F：→ wxes60711: 手從gm/id那幾張關係圖去著手會省去不少時間 12/29 21:42
40F：→ wxes60711: CORNER問題還是可以掃 不會花太多時間 但是mismatch和 12/29 21:44
41F：→ wxes60711: voltage variation就真的要看經驗還有overdesign了 12/29 21:44
42F：→ wxes60711: 結論是我認為這還是一個好工具 但是什麼情況要用不要用 12/29 21:45
43F：→ wxes60711: 就看個人認知了 也許做到滿等了這些圖不用掃大概也知道 12/29 21:46
44F：→ wxes60711: 極限在哪了 不過我沒像教主那樣強到那種地步就是了 12/29 21:47
45F：推 obov: 真的需要在掃 也就幾分鐘而已 12/30 04:07
46F：推 mos888tw: 通常換製程會在允許的範圍內留最大的margin tapout一次 12/31 14:18
47F：→ mos888tw: 不是開玩笑的...東西出來如果哭哭 整個team甲賽... 12/31 14:18