作者BreezeCat (微风)
看板Electronics
标题[问题] Modelsim跑模拟与装置版本选择
时间Sat Nov 11 01:34:54 2017
不好意思打扰板上的大大
小弟最近再带FPGA的实验
今天遇到有一组学生交过来的作业(内容是马达的位置解码器)
他们的top level档是.bdf的形式
一开始检测测资结果一直不对
後来发现是他们的装置设定是Cyclone V，当我改成Cyclone IV E後，测资结果就是正确的了
有观察到的现象是跑模拟时，modelsim的时间跳动在V里面是10～20ns在跳动，而IV时是有ps的跳动
虽然我们测试档的解析度都是设1ns，不知道这个状况有没有大大也遇过
或者是大概知道问题出在哪里？
因为我学FPGA是边做边学，知识有点零碎…有些问题真的不太明白
还希望大大们可以提点
谢谢大家
如果觉得需要看一下程式，再麻烦推文跟我说一声～我在上传看看
谢谢大家
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1F：推 eamansf96xs: 点开 V 跟 IV的 rtl看一下阿 11/11 10:12
2F：→ eamansf96xs: 还有summary比较 11/11 10:12
3F：推 mmonkeyboyy: 应该只是版子设定那里设错了@_@~ 11/13 08:29
4F：→ mmonkeyboyy: ps跳动的....嗯 可能不是很正确 11/13 08:30
5F：→ BreezeCat: 我再研究看看，前几天看一看RTL没看到有差别说 11/15 23:39
6F：推 mmonkeyboyy: diff 一下就好了 11/22 02:15
7F：→ mmonkeyboyy: 要不然也可以用logic check tool 11/22 02:15