作者yuhannn (want)
看板Electronics
标题[问题] 关於DRC错误
时间Fri Aug 16 16:32:17 2019
向各位先进请益一下，我在使用calibre进行DRC验证时，发生如下图的错误。
有事先问过TSRI工程师图2的部分为执行calibre会出现的假错，但图1所出现的错误在TSR
I官网所提供的U18制成DRC假错列表是不适用的，因为calibre DRC为未置换前的Layout。
而官网所提供的是用Qentry跑DRC的置换後Layout的假错列表，想请问这些错误是否可以
被允许。
恳请帮忙 感谢!!
https://i.imgur.com/r7isGd5.jpg
https://i.imgur.com/5sy4cmo.jpg
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1F：推 smartbit: 去看一下这些错误的文字描述, in DRC command file 08/17 09:48
2F：→ smartbit: 有関width space 的部分一定不能用，其他部分就要花一点 08/17 09:48
3F：→ smartbit: 时间研究 08/17 09:48
4F：→ smartbit: 不能有 08/17 09:49